CompactPCI PlusIO Backplanes

Grafik für CompactPCI PlusIO in Schroff - Europa, Mittlerer Osten, Afrika und Indien
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  • Konform zu: PICMG 2.0 R3.0 CompactPCI Core Specification, PICMG 2.1 R2.0 Hot Swap Specification, PICMG 2.9 R1.0 System Management Bus Specification, PICMG 2.10 R1.0 Keying Specification, PICMG 2.30 R1.0 CompactPCI PlusIO Specification PICMG CompactPCI Serial (CPCI-S.0 R1.0) Specification
  • Systemslot konform zu PICMG 2.30, 32-bit CPCI Bus auf P1, PCIe, S-ATA, USB & Ethernet auf P2
  • Ethernet-Full-mesh auf dem Systemslot und 2 CompactPCI Serial-Slots, unterstützt 1000Base T und 10GBase-T
  • V(I/O) auf 3,3 V oder 5 V einstellbar (5 V voreingestellt)
  • CompactPCI-Peripherieslots, 32-bit mit Rear I/O auf P2
  • Rear I/O auf den CompactPCI Serial-Slots auf Anfrage
  • CompactPCI Serial-Peripherieslots mit PCIe x1, S-ATA und USB

    Spezifikation:

    CompactPCI PlusIO

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Breite mm
Slotanzahl
 
Katalognummer Slotanzahl Breite mm V I/O Systemslot Rear I/O Beschreibung Höhe HE
Katalognummer Slotanzahl Breite mm V I/O Systemslot Rear I/O Beschreibung Höhe HE
3 CPCI + 2 CPCI Serial 102.2 5.0 mittig ja, an CompactPCI Slots 32-bit CompactPCI Bus 3
4 CPCI + 4 CPCI Serial 161.3 5.0 mittig ja, an CompactPCI Slots 32-bit CompactPCI Bus 3